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3827442
Vhdl source file
Descripción
CSD project_1 (EX1A)
Sin etiquetas
vhdl
design_1
csd
Mapa Mental por
Cristina Pérez9355
, actualizado hace más de 1 año
Más
Menos
Creado por
Cristina Pérez9355
hace casi 9 años
34
0
0
Resumen del Recurso
Vhdl source file
synthesis
circuit synthesized for a target chip PDL, FPGA
VHDL-based simulation TestBench
behavioral high-level simulation
Gate-level simulation
Run simulation
LAB test & measurements
Circuit_1.vhd
writing a text file scriptum editor
equation
schematic entry translation
schematic
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