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7070902
1_1_Asic
Description
Asic estructura y definicion
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asic
pld
ic
informática
Mind Map by
jonathan solorzano
, updated more than 1 year ago
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Resource summary
1_1_Asic
Evolución del IC
SSI(Small Scale Integration)
MSI (Medium Scale Integration)
LSI(Large Scale Integration)
VLSI(Very Large Scale Integration)
gates=4 transistores
Cmos
Nand
Nor
Custom ICs
Standar IC
Digitales o Análogos
Catalogos
Custom ICs
1980s
Ics personalizado
Qué es
No es un ASIC
standar IC
memorias Dram, Sram
microprocesadores
Si es un ASIC
chip
juguete que hbla
satelite
contiene un uP
Tipos
Full-Custom Asic
Ingeniero diseña las celdas logicas, circuitos
no tienen librerias de celdas
chip muy especializado
Standar-Cell Basic Asic(CBIC)
Usa celdas lógicas prediseñadas
diseñador solo ubica e interconecta las standar cell
ahorro de tiempo y dinero
Estructura
Standar-Cell Areas
filas de standar cell como paredes de ladrillos
Megacells
Celdas prediseñadas mas grandes
Gate Array Based Asic(GA)
Transistores predefinidos en el wafer
Solo capas superiores de metal definidas usando custom-mask
Channeled GA
espacios predefinidos
2 semanas fabricación
Channeless GA
conocido como SOG
no espacios predefinidos
solo se conecta layer metal 1
PLD
Disponibles en catalogos
diferentes tecnologías
celdas no personalizadas
Rom
PLD mas simple
usan un fusible metalico
Eprom
transistores Mos programables
MAsked-Rom
pueden colocarse dentro de un Asic
arreglo de transistores, programados mediante mask-patterns
Logic Arrays
misma tecnología Rom
estructuras más flexibles que Rom
arreglos and y or
PAL
Programmable-Array-Logic
PLA
Programmable-Logic-Array
FPGA
Field Programmable Gate Array
mas complejos que PLD
poca diferencia
Media attachments
4c4636ef-28eb-4ebf-a60d-ba5f4d6c19b2.JPG (image/JPG)
afcb918c-7460-4164-8738-92d19eecd082.JPG (image/JPG)
1590e186-3fdd-4bb6-831f-1dd4c6d23e36.JPG (image/JPG)
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